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譯碼器、加法器、觸發(fā)器等都屬于組合邏輯電路。
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判斷題
在實(shí)際電路中,與門、與非門的多余輸入端口最好都接高電平,以免干擾信號(hào)竄入電路。
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判斷題
觸發(fā)器的置位端(置1端)至輸出端的信號(hào)延時(shí)量一定大于觸發(fā)器由輸入端至輸出端的延時(shí)量。
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