單項(xiàng)選擇題中央處理器CPU主要由運(yùn)算器和控制器組成，控制器中（）保存了程序的地址。
A.程序計(jì)數(shù)器
B.指令寄存器
C.指令譯碼器
D.狀態(tài)/條件寄存器
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1.單項(xiàng)選擇題設(shè)某流水線計(jì)算機(jī)主存的讀/寫(xiě)時(shí)間為100ns，有一個(gè)指令和數(shù)據(jù)合一的cache，已知該cache的讀/寫(xiě)時(shí)間為10ns，取指令的命中率為98%，取數(shù)的命中率為95%。在執(zhí)行某類程序時(shí)，約有1/5指令需要存/取一個(gè)操作數(shù)。假設(shè)指令流水線在任何時(shí)候都不阻塞，則設(shè)置cache后，每條指令的平均訪存時(shí)間約為（）
A.12ns
B.15ns
C.18ns
D.120ns
2.單項(xiàng)選擇題在計(jì)算機(jī)上處理漢字，必須先對(duì)漢字進(jìn)行編碼。漢字的輸入碼主要分為數(shù)字編碼、拼音碼和字形編碼，其中重碼率最低的是（）
A.數(shù)字編碼
B.拼音碼
C.字形編碼
D.差不多
3.單項(xiàng)選擇題00110111是十進(jìn)制數(shù)37的（）
A.原碼
B.反碼
C.補(bǔ)碼
D.原碼、反碼、補(bǔ)碼
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計(jì)算機(jī)容錯(cuò)技術(shù)是指采用冗余方法消除故障影響，一般有（）和（）兩種方法。
題型：填空題
提高計(jì)算機(jī)系統(tǒng)并行性可以提高性能，一般有3種途徑，分別為（）（）和（）。
題型：填空題
簡(jiǎn)述RISC指令系統(tǒng)和CISC指令系統(tǒng)的區(qū)別。
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空白（1）處應(yīng)選擇（）
題型：?jiǎn)雾?xiàng)選擇題
簡(jiǎn)述使用直接內(nèi)存存取DMA傳輸數(shù)據(jù)的過(guò)程。
題型：?jiǎn)柎痤}
計(jì)算機(jī)硬件的典型結(jié)構(gòu)主要包括單總線結(jié)構(gòu)、雙總線結(jié)構(gòu)和采用（）的大型系統(tǒng)結(jié)構(gòu)。
題型：填空題
空白（1）處應(yīng)選擇（）
題型：?jiǎn)雾?xiàng)選擇題
X和Y分別指兩個(gè)二進(jìn)制數(shù)運(yùn)算符號(hào)，有規(guī)則如下。0X0＝0 0X1＝1 1X0＝1 1X1＝0 0Y0＝0 0Y1＝0 1Y0＝0 1Y1＝1則X是（），Y是（）。
題型：填空題
空白（2）處應(yīng)選擇（）
題型：?jiǎn)雾?xiàng)選擇題
計(jì)算機(jī)的硬件分成5大組成部件，分別為（）（）（）（）和（），其中（）負(fù)責(zé)把指令逐條從存儲(chǔ)器中取出，經(jīng)譯碼后向機(jī)器發(fā)出各種命令。
題型：填空題