A.發(fā)射結(jié)正偏置，集電結(jié)反偏置
B.發(fā)射結(jié)正偏置，集電結(jié)正偏置
C.發(fā)射結(jié)反偏置，集電結(jié)正偏置
D.發(fā)射結(jié)反偏置，集電結(jié)反偏置
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A.VD>0.5V，VD<0.7V
B.VD>0.7V，VD<0.5V
C.VD>0.7V，VD<0.7V
D.VD>0.5V，VD<0.5V
A.互非
B.對(duì)偶
C.相等
D.無(wú)任何關(guān)系
A.連續(xù)變化的
B.模擬
C.離散的
D.數(shù)字
A.幾十納秒
B.幾十微秒
C.幾百微秒
D.幾十毫秒
A.幾十納秒
B.幾十微秒
C.幾十毫秒
D.幾百毫秒
最新試題
如要將一個(gè)最大幅度為5.1V的模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào)，要求輸入每變化20mV，輸出信號(hào)的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。
電可擦除的PROM器件是（）
TTL與非門(mén)閾值電壓UT的典型值是（）
ROM可以用來(lái)存儲(chǔ)程序、表格和大量固定數(shù)據(jù)，但它不可以用來(lái)實(shí)現(xiàn)（）。
根據(jù)什么判斷簡(jiǎn)單電路中的險(xiǎn)象存在？
TTL與非門(mén)輸入短路電流IIS的參數(shù)規(guī)范值是（）。
一個(gè)兩輸入端的門(mén)電路，當(dāng)輸入為10時(shí)，輸出不是1的門(mén)電路為（）
具有“有1出0、全0出1”功能的邏輯門(mén)是（）
如果把D觸發(fā)器的輸出Q反饋連接到輸入D，則輸出Q的脈沖波形的頻率為CP脈沖頻率f的（）。
判斷如下VHDL的操作是否正確，如不正確，請(qǐng)改正。字符a和b的數(shù)據(jù)類(lèi)型是BIT，c是INTEGER，執(zhí)行c＜=a+b。