單項(xiàng)選擇題不屬于PLD基本結(jié)構(gòu)部分的是（）。
A.與門陣列
B.或門陣列
C.與非門陣列
D.輸入緩沖器
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1.單項(xiàng)選擇題PLD（可編程邏輯器件）屬于（）電路。
A.非用戶定制
B.全用戶定制
C.半用戶定制
D.自動(dòng)生成
2.單項(xiàng)選擇題邏輯器件（）屬于非用戶定制電路。
A.邏輯門
B.GAL
C.PROM
D.PLA
3.單項(xiàng)選擇題在A/D轉(zhuǎn)換器中，已知是量化單位，若采用“有舍有取”方法劃分量化電平，則量化誤差為（）。
A.1／4
B.1／2
C.1
D.2
4.單項(xiàng)選擇題已知Tcp是8位逐次漸近型A／D轉(zhuǎn)換器的輸入時(shí)鐘周期，則完成一次轉(zhuǎn)換需要的時(shí)間是（）Tcp。
A.8
B.9
C.10
D.11
5.單項(xiàng)選擇題若一個(gè)10位二進(jìn)制D／A轉(zhuǎn)換器的滿刻度輸出電壓為Vomax＝10.23V，當(dāng)輸入D=（1100000010）2時(shí)，輸出電壓為（）V。
A.2.56
B.5.12
C.7.7
D.8.58
最新試題
判斷如下VHDL的操作是否正確，如不正確，請(qǐng)改正。字符a和b的數(shù)據(jù)類型是BIT，c是INTEGER，執(zhí)行c＜=a+b。
題型：?jiǎn)柎痤}
與倒T形電阻網(wǎng)絡(luò)DAC相比，權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了（）對(duì)轉(zhuǎn)換精度的影響。
題型：?jiǎn)雾?xiàng)選擇題
什么是觸發(fā)器的空翻現(xiàn)象，如何避免空翻？
題型：?jiǎn)柎痤}
TTL與非門輸出高電平的參數(shù)規(guī)范值是（）
題型：?jiǎn)雾?xiàng)選擇題
兩個(gè)與非門構(gòu)成的基本RS觸發(fā)器，當(dāng)Q=1、Q=0時(shí)，兩個(gè)輸入信號(hào)R=1和S=1。觸發(fā)器的輸出Q會(huì)（）。
題型：?jiǎn)雾?xiàng)選擇題
一個(gè)16選一的數(shù)據(jù)選擇器，其地址輸入（選擇控制輸入）端有（）個(gè)。
題型：?jiǎn)雾?xiàng)選擇題
（）在計(jì)算機(jī)系統(tǒng)中得到了廣泛的應(yīng)用，其中一個(gè)重要用途是構(gòu)成數(shù)據(jù)總線。
題型：?jiǎn)雾?xiàng)選擇題
具有“有1出0、全0出1”功能的邏輯門是（）
題型：?jiǎn)雾?xiàng)選擇題
10-4線優(yōu)先編碼器允許同時(shí)輸入（）路編碼信號(hào)。
題型：?jiǎn)雾?xiàng)選擇題
TTL與非門閾值電壓UT的典型值是（）
題型：?jiǎn)雾?xiàng)選擇題