A.4
B.5
C.6
D.8
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A.8
B.4
C.2
D.1
A.2
B.3
C.4
D.5
A.寬度增加
B.幅度減小
C.幅度增加
D.寬度減小
A.PLA結(jié)構(gòu)是與門陣列固定連接，而或門陣列可編程
B.PLA結(jié)構(gòu)是或門陣列固定連接，而與門陣列可編程
C.PLA結(jié)構(gòu)是與門陣列和或門陣列都可以編程
D.PLA中，一個(gè)地址碼對(duì)應(yīng)的存儲(chǔ)單元是唯一的
A.10
B.11
C.12
D.13
最新試題
A*B*B**C=（）。
下列邏輯代數(shù)基本運(yùn)算關(guān)系式中不正確的是（）。
如圖12-1所示，優(yōu)先權(quán)編碼器74148有8條輸入線0～7，3條輸出線A0～A2。當(dāng)GS為0時(shí)編碼器輸出有效，E1為0時(shí)允許模塊工作。請(qǐng)問當(dāng)輸入線6為0，其余輸入線為1時(shí)，則輸出A2、A1、A0的狀態(tài)分別為（）。
一個(gè)8位的單極性D／A轉(zhuǎn)換器，最小分辨電壓△U=0．1V，則其滿度輸出電壓為（）V。
顯示譯碼器7447驅(qū)動(dòng)共陰極LED顯示器。當(dāng)7447的輸入端D、C、B、A為0、0、0、1時(shí)，LED顯示器顯示的數(shù)字應(yīng)為（）。
如果異步二進(jìn)制計(jì)數(shù)器的觸發(fā)器個(gè)數(shù)為10個(gè)，則計(jì)數(shù)狀態(tài)有（）種。
已知某邏輯電路的真值表如表所示，則該邏輯電路的最簡(jiǎn)邏輯表達(dá)式為（）。
如果一個(gè)半導(dǎo)體存儲(chǔ)器中有m位地址線，則應(yīng)有（）個(gè)存儲(chǔ)單元，若輸出位數(shù)為n位，則其存儲(chǔ)容量為（）位。
增加單穩(wěn)態(tài)觸發(fā)器的定時(shí)電阻R的值可以使輸出脈沖的（）。
關(guān)于可編程邏輯陣列PLA，下列說法正確的是（）。